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RISC-V CPU simulator

由 Czech Technical University in Prague 开发

未验证

RISC-V CPU simulator for education purposes

RISC-V processor architecture simulator for education purposes with pipeline and cache visualization.

此社区软件包未经 Czech Technical University in Prague 验证、附属或支持。

版本 0.9.8 的更改

将近 2 年前

Current project release.

链接

https://github.com/cvut/qtrvsim

https://github.com/flathub/cz.cvut.edu.comparch.qtrvsim/issues

https://github.com/flathub/cz.cvut.edu.comparch.qtrvsim

标签：

emulator risc-v education linux flatpak

可用架构:aarch64x86_64