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RISC-V CPU simulator

Name: RISC-V CPU simulator
Author: Czech Technical University in Prague

entwickelt von Czech Technical University in Prague

Unverifiziert

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RISC-V CPU simulator for education purposes

RISC-V processor architecture simulator for education purposes with pipeline and cache visualization.

Dieses von der Gemeinschaft bereitgestellte Paket wurde von Czech Technical University in Prague weder verifiziert, steht in keiner Verbindung zu oder wird von Czech Technical University in Prague unterstützt.

Änderungen in Version 0.9.8

vor fast 2 Jahren

Current project release.

Links

Projekt-Website

https://github.com/cvut/qtrvsim

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https://github.com/flathub/cz.cvut.edu.comparch.qtrvsim/issues

Manifest

https://github.com/flathub/cz.cvut.edu.comparch.qtrvsim

Schlagwörter:

emulator risc-v education linux flatpak

Verfügbare Architekturen:x86_64aarch64